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首先雙方必須約定好通信用的時鐘頻率， 但是雙方用的時鐘必定有誤差， 而且不知道每個bit 的起始時間。這兩點是造成你有時候收到對的，有時候收到錯的原因。所以必須要用高倍的時鐘來采樣，一般用8 倍、16 倍。
僅僅簡單實現的話，用8 倍舉例，如果另一塊板子（或PC）發過來的是數據，發送一個bit 用的時鐘頻率是115200Hz的話，那么自己板子上要先產生一個115200x 8 = 921600Hz的內部時鐘。用這個時鐘對收到的串行數據進行采樣，理論上講，每個bit 可以得到7-8 個采樣點。
如果FPGA晶振是50000000Hz（50MHz），則54.25 分頻得到921600Hz。
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