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為了實現(xiàn)軍航管制系統(tǒng)中雷達數(shù)據(jù)的可靠傳輸，根據(jù)HDLC協(xié)議的幀結(jié)構(gòu)和循環(huán)冗余校驗（CRC）原理，提出了一種新型的基于并行機制的HDLC協(xié)議控制器，討論采用FPGA新技術(shù)實現(xiàn)HDLC協(xié)議幀的構(gòu)成，解析模塊及其內(nèi)部的CRC碼生成，檢驗?zāi)K的方法。在FPGA內(nèi)部采用硬件描述語言（HDL）并行設(shè)計多通道的高級數(shù)據(jù)鏈路控制（HDLC）協(xié)議控制器，該協(xié)議控制器有效利用FPGA的片內(nèi)硬件資源，實現(xiàn)了并行解析和生成多通道的HDLC協(xié)議報文，提高了數(shù)據(jù)通信系統(tǒng)中的多通道擴展性，實時性和穩(wěn)定性.
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