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使用VHDL設(shè)計(jì)ALTERA SOPC編譯器的詳細(xì)資料說明

2021-01-26 | rar | 1.04 MB | 次下載 | 免費(fèi)

資料介紹

  本教程介紹Altera的sopcbuilder軟件,該軟件用于實(shí)現(xiàn)在Altera FPGA設(shè)備上使用niosii處理器的系統(tǒng)。系統(tǒng)開發(fā)流程通過給出逐步使用sopcbuilder和quartusr-II軟件實(shí)現(xiàn)一個(gè)簡(jiǎn)單系統(tǒng)的說明來說明。

  開發(fā)過程的最后一步是在實(shí)際的FPGA設(shè)備中配置所設(shè)計(jì)的電路,并運(yùn)行應(yīng)用程序。為了說明如何做到這一點(diǎn),假設(shè)用戶可以訪問Altera DE2開發(fā)和教育板,該板連接到安裝了Quartus II和Nios R II軟件的計(jì)算機(jī)。

  本教程中的屏幕截圖是使用Quartus II 7.1版獲得的;如果使用其他版本的軟件,某些圖像可能會(huì)略有不同。

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