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提出了一種基于多相濾波器的并行有限脈沖響應（finite impulse response，FIR）濾波器結構，可以有效提高濾波器運算的吞吐率，與傳統的串行濾波器結構比，并行濾波器運算速度可以提高L倍，其中L為并行的路數，并且運算延遲小。首先從理論上分析了基于多相濾波器的并行濾波原理，并以八路并行為例，對FIR濾波運算做了浮點仿真驗證。然后用經典符號數表示以及優化定點濾波器系數，并針對濾波器系數設計了流水線結構。最后在Ahera的Stratix II系列芯片上實現了定點并行濾波器。可編程邏輯陣列（field programmable gate array，FPGA）編譯以及下栽測試結果表明，該濾波器僅占用少量的資源，其等效吞吐率可以達到2 GHz。
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