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選用M+12 Timing 0ncore Receiver GPS模塊、CvcloneⅡ系列EP2C8現場可編程邏輯門陣列（FPGA）、10MHz高精度恒溫晶振等設計硬件電路，實現GPs時鐘在失步情況下精確對時。由GPS模塊接收GPS衛星授時信號，輸出秒脈沖和GPS時標至FPGA．同時恒溫晶振10 MHz脈沖信號輸至FPGA．經FPGA處理后的秒脈沖信號和GPS時標信息通過驅動電路并行送到串口或光纖模塊。軟件分成秒脈沖上升沿判別、10 MHz晶振脈沖計數、GPS失步情況下秒脈沖生成、GPS時標接收／發送4個功能模塊．用VHDL語言對各軟件模塊進行功能開發．并給出了程序清單。仿真和試驗結果表明，該方法可保證GPS時鐘在失步12 h內秒脈沖誤差小于50Us。
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