資料介紹
基于模塊化設計方法對RocketIO發(fā)送器的吉比特數(shù)據(jù)發(fā)送策 略進行了深入研究,提出了一種速率為2Gbps的多數(shù)據(jù)包透明傳輸?shù)臋C制。根據(jù)此機制,僅配置3個包格式寄存器則可實現(xiàn)對RAM內(nèi)數(shù)據(jù)以任意要求的格式發(fā) 送,從而解決了利用RocketIO發(fā)送數(shù)據(jù)固有的可升級性差的問題。該透明發(fā)送機制展示出其運用Verilog HDL高級語言的設計思想,以及升級性好,復雜度低,實現(xiàn)簡單的優(yōu)點。該方案已在Xilinx公司的現(xiàn)場可編程門陣列(FPGA)器件XC2VP20上得 到了實現(xiàn) ,驗證了基于這一發(fā)送機制的設計方法的有效性和可行性。 該研究對其它高速串行數(shù)據(jù)傳輸標準具有廣泛的應用價值.
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