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本論文主要討論和仿真了基于CPLD的PSK系統單元設計，在闡述調制解調系統的基本原理與設計方法的同時，又詳細地介紹了系統的總體電路框圖及各個模塊的具體軟硬件實現。作者以VHDL作為設計的硬件描述語言，在Altera公司的Maxplus2開發平臺上進行了程序設計及波形仿真。“自頂向下”是本設計的主要特色，所有程序都通過了以EPM7128SLC84-7作為主芯片的CPLD實驗開發板的硬件調試。
現代通信系統要求通信距離遠、通信容量大、傳輸質量好。作為其關鍵技術之一的調制
解調技術一直是人們研究的一個重要方向[5]。從模擬調制到數字調制，從二進制發展到多進制調制，雖然調制方式多種多樣，但都是朝著使通信系統更高速、更可靠的方向發展。一個系統的通信質量，很大程度上依賴于所采用的調制方式。因此，對調制方式的研究，將直接決定著通信系統質量的好壞[1]。
復雜可編程邏輯器件（CPLD）結合了專用集成電路和DSP 的優勢，既具有很高的處理
速度，又具有一定的靈活性。因此，基于CPLD 的數字調制系統的研究具有重要的實際意義。本文論述了如何用CPLD 實現PSK 數字調制系統的方法，其實現步驟包括：1.研究PSK調制系統的原理及設計方法；2.根據各個系統的總體功能與硬件特點，設計總體框圖；3.根據VHDL 語言特點，對系統進行VHDL 建模；4.根據VHDL 模型，進行具體VHDL 語言程序設計；5.對設計的程序進行波形仿真與硬件調試。
現代通信系統要求通信距離遠、通信容量大、傳輸質量好。作為其關鍵技術之一的調制
解調技術一直是人們研究的一個重要方向[5]。從模擬調制到數字調制，從二進制發展到多進制調制，雖然調制方式多種多樣，但都是朝著使通信系統更高速、更可靠的方向發展。一個系統的通信質量，很大程度上依賴于所采用的調制方式。因此，對調制方式的研究，將直接決定著通信系統質量的好壞[1]。
復雜可編程邏輯器件（CPLD）結合了專用集成電路和DSP 的優勢，既具有很高的處理
速度，又具有一定的靈活性。因此，基于CPLD 的數字調制系統的研究具有重要的實際意義。本文論述了如何用CPLD 實現PSK 數字調制系統的方法，其實現步驟包括：1.研究PSK調制系統的原理及設計方法；2.根據各個系統的總體功能與硬件特點，設計總體框圖；3.根據VHDL 語言特點，對系統進行VHDL 建模；4.根據VHDL 模型，進行具體VHDL 語言程序設計；5.對設計的程序進行波形仿真與硬件調試。
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