使用Verilog硬件描述語(yǔ)言實(shí)現(xiàn)簡(jiǎn)易函數(shù)發(fā)生器的設(shè)計(jì)說(shuō)明
資料介紹
簡(jiǎn)易函數(shù)信號(hào)發(fā)生器在電路實(shí)驗(yàn)和設(shè)備檢測(cè)中具有十分廣泛的用途。在基于QUARTUS2軟件平臺(tái)下,運(yùn)用Verilog硬件描述語(yǔ)言來(lái)進(jìn)行編寫兩種波形(方波和階梯波)發(fā)生的程序,并結(jié)合DE2板與DVCC實(shí)驗(yàn)板上的D/A轉(zhuǎn)換器在示波器顯示出波形。簡(jiǎn)易函數(shù)信號(hào)發(fā)生器具有廣泛應(yīng)用于各場(chǎng)所,通信,廣播,電視系統(tǒng)中,還廣泛運(yùn)用于測(cè)試領(lǐng)域,有制作成本低,電路簡(jiǎn)單,使用方便等優(yōu)點(diǎn)。
二、實(shí)驗(yàn)概述
1、Verilog簡(jiǎn)介
Verilog是一種流行的硬件描述語(yǔ)言,他是由工業(yè)界開(kāi)發(fā)的,1984年,Verilog作為一種私用的硬件描述語(yǔ)言,由Gateway Design Automation公司給出,1988年,Synopsis公司為Verilog開(kāi)發(fā)了綜合工具。1995年,Verilog成為IEEE的一個(gè)標(biāo)準(zhǔn)。Verilog 適合算法級(jí),寄存器級(jí),邏輯級(jí),門級(jí)和版圖級(jí)等各個(gè)層次的設(shè)計(jì)和描述。
Verilog的語(yǔ)法是基于C語(yǔ)言的。由于是基于C語(yǔ)言,所以它更容易掌握。本設(shè)計(jì)中采用Verilog語(yǔ)言進(jìn)行設(shè)計(jì)。
2、設(shè)計(jì)工具簡(jiǎn)介
本次設(shè)計(jì)是基于Altera公司的QuartusII軟件。
Quartus II 是Altera公司的綜合性PLD開(kāi)發(fā)軟件,支持原理圖、VHDL、VerilogHDL以及AHDL(Altera Hardware Description Language)等多種設(shè)計(jì)輸入形式,內(nèi)嵌自有的綜合器以及仿真器,可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
QuartusII支持Altera的IP核,包含了LPM/MegaFuction宏功能模塊庫(kù),使用它,可以簡(jiǎn)化設(shè)計(jì)的復(fù)雜性,加快設(shè)計(jì)速度。QuartusII平臺(tái)支持一個(gè)工作組環(huán)境下的設(shè)計(jì)要求,其中包括支持基于Internet的協(xié)作設(shè)計(jì)。此外,QuartusII通過(guò)和DSP Builder工具與Matlab/SIMULINK相結(jié)合,可以方便地實(shí)現(xiàn)各種DSP應(yīng)用系統(tǒng);支持Altera的片上可編程系統(tǒng)開(kāi)發(fā),集系統(tǒng)級(jí)設(shè)計(jì)、嵌入式軟件設(shè)計(jì)、可編程邏輯設(shè)計(jì)于一體,是一種綜性的開(kāi)發(fā)平臺(tái)。
3、簡(jiǎn)易函數(shù)發(fā)生器
簡(jiǎn)易函數(shù)(波形)信號(hào)發(fā)生器能產(chǎn)生某些特定的周期性時(shí)間函數(shù)波形(正弦波、方波、三角波、鋸齒波和階梯波等)信號(hào),頻率范圍可從幾個(gè)微赫到幾十兆赫函數(shù)信號(hào)發(fā)生器在電路實(shí)驗(yàn)和設(shè)備檢測(cè)中具有十分廣泛的用途。而因此電子專業(yè)的學(xué)生,對(duì)函數(shù)信號(hào)發(fā)生器的設(shè)計(jì),仿真,制作已成為最基本的一種技能,也是一個(gè)很好的鍛煉機(jī)會(huì),是一種綜合能力的鍛煉,它涉及基本的電路原理知識(shí),仿真軟件的使用,以及電路的搭建,既考驗(yàn)基礎(chǔ)知識(shí)的掌握,又鍛練動(dòng)手能力。
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