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DDS有關名詞解釋:1． 參考時鐘/系統時鐘(REFERENCE CLOCK / SYSTEM CLOCK )
參考時鐘就是DDS 的輸入時鐘頻率。
系統時鐘就是DAC 的采樣率，頻率越高，能夠輸出的頻率也就越高，輸出頻率應小于40%系統時鐘頻率。如果不使用內部PLL 倍頻器，參考時鐘就等于系統時鐘，如果使用PLL 倍頻器（倍頻系數為M）或者分頻器（分頻系數為R），那么系統時鐘為參考時鐘×M 或者參考時鐘÷R。
2． 頻率控制字(Frequency Tuning Word）
頻率控制字的值M 決定了輸出頻率， 。頻率控制字位數（N）越高，輸出頻率的分辨率就越高，頻率分辨率為Fc/2N。
3． DAC 輸出電壓范圍 （Voltage Compliance Range）
對于電流輸出型DAC，DAC 的輸出電壓必須在一定范圍之內。輸出電流在負載上建立的電壓的值，一定要在這個范圍之內。否則，輸出級有可能會損壞。
4． 無雜散動態范圍（SFDR）
無雜散動態范圍(SFDR)是信號RMS 值與一定帶寬內最大雜散頻譜分量RMS 值的比率，
可以分為寬帶的SFDR（wideband SFDR）和窄帶的SFDR（Narrowband SFDR），這里寬帶的定義通常為從直流一直到奈奎斯特頻率（即系統主頻一半），窄帶的頻寬一般為±15KHz，±50KHz, ±250KHz, ±1MHz 等。
5． 殘留相位噪聲（Residual Phase Noise）
給定輸出頻率的條件下，一定頻偏位置上的1Hz 帶寬內的噪聲功率與輸出信號功率的比值，單位為dBc/Hz@xkHz。
表 1 為AD9956 輸出19.7MHz 時候，不同頻偏的情況下的相位噪聲。
參考時鐘就是DDS 的輸入時鐘頻率。
系統時鐘就是DAC 的采樣率，頻率越高，能夠輸出的頻率也就越高，輸出頻率應小于40%系統時鐘頻率。如果不使用內部PLL 倍頻器，參考時鐘就等于系統時鐘，如果使用PLL 倍頻器（倍頻系數為M）或者分頻器（分頻系數為R），那么系統時鐘為參考時鐘×M 或者參考時鐘÷R。
2． 頻率控制字(Frequency Tuning Word）
頻率控制字的值M 決定了輸出頻率， 。頻率控制字位數（N）越高，輸出頻率的分辨率就越高，頻率分辨率為Fc/2N。
3． DAC 輸出電壓范圍 （Voltage Compliance Range）
對于電流輸出型DAC，DAC 的輸出電壓必須在一定范圍之內。輸出電流在負載上建立的電壓的值，一定要在這個范圍之內。否則，輸出級有可能會損壞。
4． 無雜散動態范圍（SFDR）
無雜散動態范圍(SFDR)是信號RMS 值與一定帶寬內最大雜散頻譜分量RMS 值的比率，
可以分為寬帶的SFDR（wideband SFDR）和窄帶的SFDR（Narrowband SFDR），這里寬帶的定義通常為從直流一直到奈奎斯特頻率（即系統主頻一半），窄帶的頻寬一般為±15KHz，±50KHz, ±250KHz, ±1MHz 等。
5． 殘留相位噪聲（Residual Phase Noise）
給定輸出頻率的條件下，一定頻偏位置上的1Hz 帶寬內的噪聲功率與輸出信號功率的比值，單位為dBc/Hz@xkHz。
表 1 為AD9956 輸出19.7MHz 時候，不同頻偏的情況下的相位噪聲。
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