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設(shè)計了一種用于高速ADC中的全差分套筒式運算放大器.從ADC的應(yīng)用指標(biāo)出發(fā),確定了設(shè)計目標(biāo),利用開關(guān)電容共模反饋、增益增強(qiáng)等技術(shù)實現(xiàn)了一個可用于12 bit精度、100 MHz采樣頻率的高速流水線(Pipelined)ADC中的運算放大器.基于SMIC 0.13 μm,3.3 V工藝,Spectre仿真結(jié)果表明,該運放可以達(dá)到105.8 dB的增益,單位增益帶寬達(dá)到983.6 MHz,而功耗僅為26.2 mW.運放在4 ns的時間內(nèi)可以達(dá)到0.01%的建立精度,滿足系統(tǒng)設(shè)計要求.
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