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“鎖相環”(PLL) 是現代通信系統的基本構建模塊。PLL 通
常用在無線電接收機或發射機中，主要提供“本振”(LO) 功
能；也可用于時鐘信號分配和降噪，而且越來越多地用作高采
樣速率模數 (A/D) 轉換的時鐘源。
隨著集成電路加工中功能器件的尺寸縮小，器件電源電壓也
呈下降趨勢，包括 PLL 和其它混合信號功能所用的電源。然
而，PLL 的關鍵元件——“壓控振蕩器”(VCO) 的實用技術
要求并未隨之大幅降低。許多高性能 VCO 設計仍然采用分
立電路來實施，可能要求高達 30 V 的電源電壓。這就給當今
的 PLL 或 RF 系統設計師提出了挑戰：低壓 PLL IC 如何與高
壓 VCO 實現接口。電平轉換接口通常利用有源濾波電路來實
施，這將在下文討論。
本文將分析說明 PLL 的基本原理，考察采用高壓 VCO 的 PLL
設計的當前技術水平，討論典型架構的利弊，并介紹高壓
VCO 的一些替代方案。
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