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12位時間交織流水線adc的設計與通道失配分析-
高性能的模數轉換器越來越多的應用在國防、通信和高端家電等領域，是電子信息產業中的一項關鍵技術。隨著電子信息領域的發展，各種通信設備的工作速度不斷提高，因此對于高速模數轉換器的需求日趨迫切。
傳統結構的ADC在保證精度的情況下，速度實現幾乎達到了極限。因此，將單通道的ADC并行化是突破轉換速率的限制并不犧牲精度的有效方法。多通道時間交織技術存在著固有的弊端，即通道間的增益失配、失調失配和采樣時刻失配會降低系統精度，需要校正技術消除誤差。
本文首先基于CMOS Smic0.18um工藝設計了一款12位50MHz的單通道流水線ADC，在輸入561.523kHz的正弦信號時，信噪失真比（SNDR）達到70.3581dB，動態無雜散范圍（SFDR）為77.9108dB，有效位數（ENOB）為11.5137位。在此基礎上，詳細分析了雙通道時間交織流水線ADC的失配產生原因，通過數學推導將失調失配、增益失配和采樣時刻失配對系統精度的影響進行量化，并利用Matlab建模仿真驗證三種失配在時間交織系統中產生的影響。針對誤差消除，采用基于LMS-FIR及CIC內插濾波的校正算法，設計了12位100M的雙通道時間交織流水線ADC系統。仿真結果表明，采樣時鐘100MHz，輸入信號頻率561.523kHz時，經過校正后系統輸出的動態無雜散范圍達到75.98dB。
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| 12位時間交織流水線adc的設計與通道失配分析.pdf | 5M |
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