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基于數字后處理算法的并行交替采樣ADC系統-
摘要：為了在現有的模/數轉換（ADC）芯片的技術條件下提高模/數轉換系統的性能，在并行交替采樣系統失配誤差修正算法的基礎上，研制了8bit4-Gsps并行交替采樣ADC系統。該系統中4個1GspsADC通道并行采樣同一模擬信號：以鎖相環和可調延遲錢芯片為核心，組成低jitter、低skew的多相時鐘產生電路，為各ADC通道提供交替采樣時鐘：在FPGA芯片雙倍速I/0和內部集成鎖相環的支持下，使用單片FPGA芯片接收ADC系統產生的高選并行數據，并完成數據同步、重排和緩存，通過USB接口讀出。基于模擬數字混合濾波器組的數字后處理算法修正了各ADC通道間的增益、偏置和采樣間隔三種失配誤差。測試結果表明，該并行交替采樣ADC系統在4-Gp采樣率下，對200MHz與803MH2正弦波信號分別達到6.89b與5.81b的ENOB以及51.81dB和51.13dB的SFDR，接近ADC芯片手冊給出的性能。關鍵詞：模/教變換；高速電路設計；數字濾波；并行交替采樣
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| 基于數字后處理算法的并行交替采樣ADC系統.pdf | 774K |
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