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（1）門級(jí)電路的功耗優(yōu)化綜述 門級(jí)電路的功耗優(yōu)化(Gate Level Power Optimization，簡(jiǎn)稱GLPO)是從已經(jīng)映射的門級(jí)網(wǎng)表開始，對(duì)設(shè)計(jì)進(jìn)行功耗的優(yōu)化以滿足功耗的約束，同時(shí)設(shè)計(jì)保持其性能，即滿足設(shè)計(jì)規(guī)則和時(shí)序的要求。功耗優(yōu)化前的設(shè)計(jì)是已經(jīng)映射到工藝庫(kù)的電路，如下圖所示： 門級(jí)電路的功耗優(yōu)化包括了設(shè)計(jì)總功耗，動(dòng)態(tài)功耗以及漏電功耗的優(yōu)化。對(duì)設(shè)計(jì)做優(yōu)化時(shí)，...
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