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多核處理器以其高性能、低功耗、設計周期短等諸多優勢成為未來高性能處理器的發展趨勢。由于應用對計算能力的需求是無限的，隨著芯片上晶體管數目的進一步增多，多核處理器將逐漸過渡到大規模多核處理器或者稱為眾核處理器。多核處理器面臨著很多的設計挑戰，其中可靠性問題尤其嚴重。一方面，由于多核處理器的芯片面積都比較大，生產缺陷導致的成品率損失問題嚴重。這使得芯片上可能存在失效的處理器核，而且不同芯片上失效核的位置和分布也不相同。另一方面，工藝擾動問題使得多核處理器上各個處理器核的性能也存在差異。芯片上處理器核的失效以及性能差異使得不同芯片的底層結構各不相同，這給上層的操作系統和軟件優化帶來了負擔。我們借助虛擬化的思想，將缺陷和核間性能差異對軟件層進行屏蔽，提供統一的接口和界面，便于編程開發和管理。
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