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      電子發(fā)燒友網(wǎng)>電子資料下載>電子資料>芯片層級(jí)和系統(tǒng)層級(jí)靜電放電測(cè)試的區(qū)別差異

      芯片層級(jí)和系統(tǒng)層級(jí)靜電放電測(cè)試的區(qū)別差異

      2020-07-28 | pdf | 0.10 MB | 次下載 | 1積分

      資料介紹

      隨著半導(dǎo)體制程技術(shù)的不斷演進(jìn)，以及集成電路大量的運(yùn)用在電子產(chǎn)品中，靜電放電已經(jīng)成為影響電子產(chǎn)品良率的主要因素美國(guó)最近公布因?yàn)殪o電放電而造成的國(guó)家損失，一年就高達(dá)兩百多億美金，而光是電子產(chǎn)品部份就達(dá)到一百多億美金之多。為了有效的防范靜電放電所造成的損害，國(guó)際間眾多的靜電放電協(xié)會(huì)，分別針對(duì)不同的環(huán)境應(yīng)用下制定了不同的靜電測(cè)試規(guī)范。其中針對(duì)IC在生產(chǎn)、制造、測(cè)試及運(yùn)輸過程的靜電放電規(guī)范，是以美國(guó)車方所制定的人體靜電放電模型最具代表性，又稱之為芯片層級(jí)靜電放電測(cè)試。而針対終端消費(fèi)者所使用的電子產(chǎn)品，則以IEC61000-4-2所制定的人體靜電放電模型為測(cè)試主流，這就是一般認(rèn)知的系統(tǒng)層級(jí)靜電放電測(cè)試。

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