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PLL 頻率合成器基本構建模塊 PLL 頻率合成器可以從多個基本構建模塊的角度來考察。我們在前面已經提到過這個問題，下面將更加詳細地進行探討：鑒頻鑒相器（PFD） 參考計數器（R） 反饋計數器（N） 鑒頻鑒相器（PFD） 頻率合成器的核心是鑒相器，也稱鑒頻鑒相器。在鑒相器中，將比較參考頻率信號與從 VCO 輸出端反饋回來的信號，結果得到的誤差信號用于驅動環路濾波器和 VCO。在數字 PLL （DPLL）中，鑒相器或鑒頻鑒相器是一個邏輯元件。三種最常用的實現方法為：異或（EXOR）柵極 J-K 觸發器數字鑒頻鑒相器這里，我們只考慮 PFD，這也是 ADF4110 和 ADF4210 頻率合成器系列中使用的元件，因為與 EXOR 柵極和 J-K 觸發器不同，處于解鎖狀態時，其輸出為頻差以及兩個輸入間相差的函數。圖 1 所示為 PFD 的一種實現方案，該類器件基本上由兩個 D 型觸發器組成。一路 Q 輸出使能正電流源，另一路 Q 輸出則使能負電流源。假設本設計中 D 型觸發器由正邊沿觸發，則狀態為（Q1， Q2）： 11–兩個輸出均為高電平，由反饋至觸發器上 CLR 引腳的 AND 柵極（U3）禁用。 00–P1 和 N1 均關閉，輸出 OUT 實際處于高阻抗狀態。 10–P1 開啟，N1 關閉，輸出位于 V+。 01–P1 關閉，N1 開啟，輸出位于 V–。
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