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為提高卷積神經(jīng)網(wǎng)絡(luò)（CNN）的計(jì)算效率和能效，以8bit定點(diǎn)數(shù)據(jù)作為輸入，設(shè)計(jì)一個(gè)支持激活、批標(biāo)準(zhǔn)化以及池化等CNN網(wǎng)絡(luò)中常見計(jì)算類型的卷積加速器，優(yōu)化循環(huán)計(jì)算順序并將其與數(shù)據(jù)復(fù)用技術(shù)相結(jié)合，以提高卷積計(jì)算的效率。基于軟硬件協(xié)同設(shè)計(jì)思想，構(gòu)建包含RISCⅤ處理器和卷積加速器的SoC系統(tǒng)，RISC-V處理器基于開源的指令集標(biāo)準(zhǔn)，可以根據(jù)具體的設(shè)計(jì)需求擴(kuò)展指令功能。將該SoC系統(tǒng)部署在 Xilinx ZCU102開發(fā)板上ISC-V處理器和卷積加速器分別工作在100MHz和300MHz頻率下，測(cè)試結(jié)果表明，該加速器的算力達(dá)到53.6GOP/s，運(yùn)行VGG16網(wǎng)絡(luò)進(jìn)行圖片推理計(jì)算時(shí)加速效果較好。
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