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隨著集成電路工藝不斷改進，電荷共享效應誘發的單粒子多點翻轉已經成為影響芯片可靠性的重要因素為此提出一種有效容忍單粒子多點翻轉的加固鎖存器：低功耗多點翻轉加固鎖存器（ low power multiple node upsethardened latch. LPMNUHL）。該鎖存器基于單點翻轉自恢復的雙聯互鎖存儲單元（ dual interlocked storage cell.DICE構建三模冗余容錯機制，輸岀端級聯¨三中取二”表決器。可以有效地容忍單粒子多點翻轉，表決輸岀正確邏輯值。不會出現高阻態，可以有效地屏蔽電路內部節點的軟錯誤。該鎖存器能夠100%容忍三點翻轉，四點翻轉的容忍率高達90.30%.通過運用高速傳輸路徑、時鐘選通技術和鐘控表決器，該鎖存器有效地降低了功耗.32nm工藝下 SPICE仿真表明，與加固性能最好的三點翻轉加固鎖存器綜合比較， LPMNUHL的延遲平均降低了40.16%，功耗平均降低了44.96%，功耗延遲積平均降低了65.40%，面積平均降低了34.60%、并且對電壓/溫度波動不敏感。
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