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電子骰子或1至6（3位）的隨機數生成器。使用FPGA將隨機數顯示在共陽極7段顯示屏上。
硬件組件：
MINI_SP6-SPARTAN 6 FPGA開發板×1個
USB-A至Mini-USB電纜×1個
共陽極7段顯示×1個
面包板（通用）×1個
公/母跳線×1個
軟件應用程序和在線服務：
Xilinx軟件開發套件
VHDL實現從1到6（3位）的隨機數生成器。隨機數顯示在共陽極7段顯示器上。因此，它可以用作電子骰子。在Xilinx Spartan 6 FPGA上實現。.vhd是VHDL文件。ucf是用戶實現文件。用.ucf文件中的引腳分配FPGA上的IO引腳。隨機數的生成是通過在時鐘脈沖處對位向量進行連續XOR操作來完成的。該項目可以用來代替Ludo游戲中使用的傳統骰子。
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