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      用于千兆位收發(fā)器應(yīng)用的全數(shù)字VCXO替代方案(UltraScale FPGA)

      2023-09-14 | pdf | 1.27 MB | 次下載 | 2積分

      資料介紹

      本應(yīng)用筆記提供了一個系統(tǒng)，旨在利用每個串行千兆位收發(fā)器中的功能來取代外部壓控晶體振蕩器（VCXO）電路。
      常見的設(shè)計要求是將收發(fā)器輸出的頻率或相位鎖定到輸入端源（稱為循環(huán)、恢復(fù)或從定時）。傳統(tǒng)上，外部時鐘清潔器件或VCXO和PLL元件用于為以下目標提供高質(zhì)量的時鐘基準收發(fā)器，因為基于FPGA邏輯的時鐘通常噪聲太大。雖然有效，但外部時鐘組件的功耗和成本損失是累加的，因為每個單獨的時鐘通道已生成。當使用多個通道或在低成本系統(tǒng)中時，成本可能是重要。此外，添加許多外部時鐘源提供了更多機會板級串擾和干擾。

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