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      電子發(fā)燒友網(wǎng)>電子資料下載>電子資料>Vivado設(shè)計(jì)套件用戶指南(設(shè)計(jì)流程概述)

      Vivado設(shè)計(jì)套件用戶指南(設(shè)計(jì)流程概述)

      2023-09-15 | pdf | 2.41 MB | 次下載 | 2積分

      資料介紹

      本用戶指南概述了如何使用 Vivado? 設(shè)計(jì)套件創(chuàng)建用于編程到 Xilinx? 器件的新設(shè)計(jì)。它簡要介紹了各種使用模型、設(shè)計(jì)功能和工具選項(xiàng)，包括準(zhǔn)備、實(shí)現(xiàn)和
      管理設(shè)計(jì)源和知識產(chǎn)權(quán) （IP） 內(nèi)核。
      Vivado 設(shè)計(jì)套件提供多種方式來完成 Xilinx 中涉及的任務(wù)設(shè)備設(shè)計(jì)、實(shí)施和驗(yàn)證。您可以使用傳統(tǒng)的寄存器轉(zhuǎn)移電平 （RTL） 到比特流 FPGA 設(shè)計(jì)流程，如 RTL 到比特流設(shè)計(jì)流程中所述。您還可以使用專注于知識產(chǎn)權(quán)的系統(tǒng)級集成流以 （IP） 為中心的設(shè)計(jì)和基于 C 的設(shè)計(jì)，如替代 RTL 到比特流設(shè)計(jì)中所述流。
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