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簡介：針對擴頻通信系統的載波同步,提出一套完善的數字鎖相環設計方案. 該方案利用新穎的可控根法完成1～3階模擬鎖相環(APLL)環路參數設計,并實現從模擬域到數字域的轉換,得到的數字鎖相環(DPLL)的環路參數由單邊環路噪聲帶寬BL 和采樣間隔T確定. 分別對各階數字鎖相環的穩定約束、各種輸入條件下的相位誤差瞬態響應、穩態相位誤差以及存在噪聲時環路的跟蹤性能進行理論分析,從而得到BL 與T的選取原則. 實驗結果證明了分析的正確性和設計的有效性.
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