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電子發(fā)燒友網(wǎng)>電子資料下載>課件下載>VHDL語言要素

VHDL語言要素

2016-11-21 | ppt | 493KB | 次下載 | 2積分

資料介紹

VHDL語言要素,大學(xué)EDA課程必備資料,在實(shí)際的應(yīng)用中,VHDL仿真器講INTEGER類型的數(shù)據(jù)作為有符號(hào)數(shù)處理,而綜合器將INTEGER作為無符號(hào)數(shù)處理. VHDL綜合器要求利用RANGE子句為所定義的整數(shù)限定取值的范圍,然后根據(jù)所定義的范圍決定它是信號(hào)還是變量的二進(jìn)制數(shù)的位數(shù),因?yàn)閂HDL綜合器無法綜合未限定范圍的整數(shù)類型的信號(hào)或變量.
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