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設計并制作一個8路數字信號發生器與邏輯分析儀，其結構框圖如圖1所示：
?
二、要求
1、基本要求
（1）制作數字信號發生器
能產生8路可預置的邏輯信號序列，并能夠重復輸出，輸出信號電平在1V～5V范圍內可調節，輸入時鐘頻率范圍100Hz～5MHz。邏輯信號序列示例如圖2，3所示。
? （2）制作邏輯分析儀
a．具有采集8路邏輯信號的功能，支持定時分析和狀態分析,最大定時取樣速率5MHz，采樣時鐘周期最小步進為200ns，最大狀態時鐘速率500KHz。
b．支持邊沿觸發（上升沿和下降沿），單級觸發字。在信號滿足觸發條件時，能對被測信號進行采集、存儲。
c． 輸入電路的輸入阻抗大于50kΩ，其邏輯信號門限電壓設置范圍1V～5V（10mV 增量）。
d．能清晰穩定地顯示所采集到的8路信號波形，并顯示觸發點位置。
e．每通道的存儲深度為500bit。
2、發揮部分
（1）最大定時取樣速率10MHz，采樣時鐘周期最小步進為100ns。
（2）能顯示可移動的時間標志線，并顯示時間標志線所對應時刻的輸入信號的邏輯狀態。
（3）支持脈沖寬度觸發（≥, ≤，脈沖包括正脈沖和負脈沖，最小脈沖寬度為5μs）。
（4）觸發位置可設置為開始，中間，結束或用戶定義。
（5）可測量兩條可移動時間標志線之間的時間間隔。
（6）其它（如增加存儲深度后分頁顯示等）。
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二、要求
1、基本要求
（1）制作數字信號發生器
能產生8路可預置的邏輯信號序列，并能夠重復輸出，輸出信號電平在1V～5V范圍內可調節，輸入時鐘頻率范圍100Hz～5MHz。邏輯信號序列示例如圖2，3所示。
? （2）制作邏輯分析儀
a．具有采集8路邏輯信號的功能，支持定時分析和狀態分析,最大定時取樣速率5MHz，采樣時鐘周期最小步進為200ns，最大狀態時鐘速率500KHz。
b．支持邊沿觸發（上升沿和下降沿），單級觸發字。在信號滿足觸發條件時，能對被測信號進行采集、存儲。
c． 輸入電路的輸入阻抗大于50kΩ，其邏輯信號門限電壓設置范圍1V～5V（10mV 增量）。
d．能清晰穩定地顯示所采集到的8路信號波形，并顯示觸發點位置。
e．每通道的存儲深度為500bit。
2、發揮部分
（1）最大定時取樣速率10MHz，采樣時鐘周期最小步進為100ns。
（2）能顯示可移動的時間標志線，并顯示時間標志線所對應時刻的輸入信號的邏輯狀態。
（3）支持脈沖寬度觸發（≥, ≤，脈沖包括正脈沖和負脈沖，最小脈沖寬度為5μs）。
（4）觸發位置可設置為開始，中間，結束或用戶定義。
（5）可測量兩條可移動時間標志線之間的時間間隔。
（6）其它（如增加存儲深度后分頁顯示等）。
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