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隨著信息技術和通信技術的發展，人們對信息傳輸速率的要求越來越高，如對高清電視、視頻會議等服務的需求日益高漲，從而對調制解調這一制約傳輸速率的環節提出了更高的速率要求。傳統的高速調制解調器多為高速模擬調制解調器。隨著數字芯片處理速度的不斷提高，可靠性更高、靈活性更大的高速數字調制解調器得到了越來越廣泛的應用。
而高速數字調制解調器的速率仍會受限于其所采用的數字信號處理芯片的最高處理速度。在諸多數字芯片中，FPCA的處理速度最快，常用于高速信號處理領域。而FPCA的處理速率主要受限于其主時鐘頻率。若采用傳統的串行調制技術就難以突破主時鐘頻率對調制速率的限制。若想進一步提高調制速率，就必須先將高速數據分流到各個支路以降低速率，其后采用并行結構進行處理。
文中對差分編碼、成形濾波等各個調制步驟的并行處理算法進行了研究，將這些模塊轉化為并行結構，從而在時鐘頻率受限的情況下提高了處理速率，并對這些結構進行了深度優化，以減少資源消耗，便于FPGA實現。
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