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介紹了3DES 數據加密算法（DDA）的原理，針對利用FPGA 硬件實現3DES 算法，給出
了一種可進化IP 核的具體設計思想，采用可重構電路節省器件內部資源，并采用有限狀態機設計技術從而實現數據高速安全傳輸。本設計是在ALTERA 公司的Quartus II 環境下實現的，并成功下載到支持電路部分重構的Xilinx Virtex II 系列器件中的XC2V1500 芯片中。
關鍵詞 可進化IP 核 3DES FPGA 有限狀態機
Abstract This paper introduces the theory of 3DES encrypt arithmetic, presents a detailed design idea of adaptive IP core Acording to using FPGA hardware to realize 3DES, adopt reconstituted circuit to save inner resource of chips, and adopt design method of finite-state machine(FSM),accordingly realize data transfer in a high speed and security way.This design realized in Quartus II condition of ALTERA Corporation,and successfully download to XC2V1500 chip.
Keywords adaptive IP core 3DES FPGA finite-state machine
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