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基于SCM算法為CPU電壓調(diào)節(jié)設計研究

2017-10-28 | rar | 0.72 MB | 次下載 | 1積分

資料介紹

  隨著集成電路的發(fā)展,現(xiàn)代CPU芯片集成度越來越高,性能飛速發(fā)展,伴隨而來的是居高不下的功耗和散熱成本,單位面積的功耗太高已成為了CPU性能突破的瓶頸。如何降低CPU芯片的功耗,成為了當前研究的重點。

  CPU 低功耗技術很多,譬如時鐘門控技術(Clock gating ),電源門控技術(Power gating )和動態(tài)電壓頻率調(diào)節(jié)技術(DVFS) 等。其中Clock gating 技術通過在電路中增加額外的邏輯單元、優(yōu)化時鐘樹結構來節(jié)省能量。Power gating 技術通過關掉當前電路中空閑的模塊,從而節(jié)省能量凹。DVFS 技術通過動態(tài)調(diào)節(jié)當前芯片的電壓和頻率來節(jié)省能量。這3種方法在CPU 中都有廣泛的應用。

基于SCM算法為CPU電壓調(diào)節(jié)設計研究

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