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集成電感對多相電壓調(diào)節(jié)模塊（ VRM）穩(wěn)態(tài)和動態(tài)特性有重要影響，合理的耦合度可以提高VRM的輸出動態(tài)響應，并能夠降低每一通道的穩(wěn)態(tài)紋波。提出一種利用小電感單元進行矩陣組合的陣列式集成電感，分析電感集成原理，給出陣列式集成電感的單元位置拓撲和單元組合結構拓撲，并分析自感互感單元匝比和磁阻比與電感耦合度的關系。通過電路方程推導了多相VRM耦合電感的等效穩(wěn)態(tài)與暫態(tài)電感，獲得多相VRM集成電感耦合度的設計準則。耦合度范圍對比表明，所提出的陣列式集成電感的集成耦合度與設計準則完全一致。利用設計準則設計四相陣列式集成電感，實驗樣機測試結果驗證了設計準則的正確性。將實驗樣機應用于四相VRM，實驗結果表明應用陣列式集成電感的VRM具有良好的穩(wěn)態(tài)和動態(tài)特性，證明了所提出的陣列式集成電感具有實用性。
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