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近年來(lái)，隨著集成電路設(shè)計(jì)技術(shù)的高速發(fā)展，功耗已經(jīng)成為該領(lǐng)域中除速度、面積之外需要考慮的第三因素。如今低功耗設(shè)計(jì)從電路基本組成因素出發(fā)，在設(shè)計(jì)的各個(gè)階段采用不同的設(shè)計(jì)以降低系統(tǒng)功耗，以取得最大限度的低功耗效果。本文緊跟市場(chǎng)發(fā)展動(dòng)向，從以上應(yīng)用角度出發(fā)，著力研究集成電路設(shè)計(jì)中小數(shù)乘法器的前端低功耗算法以及實(shí)現(xiàn)技術(shù)，并且改進(jìn)了現(xiàn)有低功耗設(shè)計(jì)技術(shù)的一些不足之處。
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