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電子發燒友網>電子資料下載>電子論文>嵌入式技術論文>雙DSP結構的捷聯控制與解算系統設計

雙DSP結構的捷聯控制與解算系統設計

2009-08-04 | rar | 281 | 次下載 | 2積分

資料介紹

設計了基于雙DSP 結構的捷聯控制與解算系統,該系統以高性能的浮點處理器TMS320VC33 作為捷聯系統實時解算的核心,以TMS320VC5402 作為通道控制、數據采
集的控制核心,并結合FPGA 的組合邏輯和時序邏輯,構成了高集成度的嵌入式系統。該系統具有采樣速度快、浮點處理精度高、穩定性好等特點,可以充分滿足捷聯導航系統的要求。
關鍵詞:捷聯慣導系統;DSP;FPGA;HPI
Abstract:The strapdown controlling and solution system based on the structure of double
DSP is designed. This system includes high-performance floating point processor
TMS320VC33,which acts as real-time solution core of strapdown system, as well as TMS
320VC5402,which services as the core to be master of access controlling and data acquisition.
This system is a kind of embedded high-integration system which has FPGA assembled and
scheduling logic. The system has the characteristics of fast sampling, high precision of floating point processing, stability, and etc. It can fully satisfy the requirements of strapdown system.
Key words: strapdown inertial system; DSP; FPGA ; HPI
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