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設計了一個硬件信號量模塊，可實現互斥和柵障等同步功能。與使用處理器原子操作指令相比，該方法具有指令數目少、執行效率高的優點。為提高存儲器使用效率，基于便箋式存儲器的結構特點，設計了具有絕對地址映射和虛擬地址映射兩種尋址模式的共享程序存儲器以支持指令存儲空間復用。FPGA實驗結果證明，該設計與傳統的采用L2緩存方式相比，可以將多核處理器系統的程序性能提高14.7%。
關 鍵 詞 數字信號處理器; 硬件信號量; 共享存儲; 同步
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