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基于VHDL的正交編碼脈沖電路解碼計(jì)數(shù)器設(shè)計(jì)

2010-03-01 | rar | 3333 | 次下載 | 10積分

資料介紹

針對(duì)正交編碼脈沖電路脈沖(quadratureencoderpulse,QEP)的解碼和計(jì)數(shù)的問(wèn)題,給出了QEP解碼計(jì)數(shù)器的解決方案.本方案在復(fù)雜可編程邏輯器件(complexprogrammablelogicdevice,CPLD)中使用VHDL(VHSIChardwarede?
scriptionlanguage)實(shí)現(xiàn)語(yǔ)言硬件編程.整個(gè)解碼計(jì)數(shù)器設(shè)計(jì)分為脈沖邊沿檢測(cè)器,計(jì)數(shù)脈沖和計(jì)數(shù)方向發(fā)生器,上下行計(jì)數(shù)器三部分,成功的解決了由傳感器抖動(dòng)引起頻繁換向時(shí)準(zhǔn)確計(jì)數(shù)的問(wèn)題.該解決方案使用Altera公司的QuartusII軟件進(jìn)行設(shè)計(jì)并進(jìn)行了仿真分析,最后給出了基于此技術(shù)的機(jī)床數(shù)顯表的應(yīng)用實(shí)例來(lái)說(shuō)明此技術(shù)的可行性和柔性.
關(guān)鍵詞:正交編碼脈沖;解碼;VHDL硬件語(yǔ)言編程;復(fù)雜可編程邏輯器件

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jolin多谢,最近正好在看这个。非常有用2011-03-28 15:42回复举报

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