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數(shù)模轉(zhuǎn)換器可以將一個(gè)二進(jìn)制數(shù)字量轉(zhuǎn)換成與該數(shù)字量成正比的電壓值，可應(yīng)用于可編程電壓源、波形發(fā)生器等。本文采用數(shù)字化技術(shù)，用FPGA 實(shí)現(xiàn)了一個(gè)簡(jiǎn)單的一階8 位Σ-Δ 型DAC，只占用幾個(gè)CLB。FPGA 的速度和柔性的輸出結(jié)構(gòu)非常適合該DAC 的實(shí)現(xiàn)。
關(guān)鍵詞：Σ-Δ DAC，F(xiàn)PGA，VerilogHDL，可綜合
性
在各類(lèi)電子系統(tǒng)中，數(shù)字電路所占比重越來(lái)越大。這主要是因?yàn)閿?shù)字電路相對(duì)于 電路有一些突出的優(yōu)點(diǎn)，例如：1 數(shù)字電路中的有源器件工作在飽和區(qū) 與截止區(qū)，工作狀態(tài)穩(wěn)定；2 數(shù)字電路處理的是二值信號(hào)，易于存儲(chǔ)和再生；3 數(shù)字電路是由大量相同的基
本單元，如門(mén)、觸發(fā)器等所組成，易于大規(guī)模集成，易于自動(dòng)化設(shè)計(jì)工具的應(yīng)用等。再加上數(shù)字計(jì)算機(jī)和數(shù)字信號(hào)處理技術(shù)的迅速發(fā)展，使得數(shù)字電路從集成規(guī)模、應(yīng)用范圍及設(shè)計(jì)自動(dòng)化程度等方面都大大超過(guò)了模擬電路，越來(lái)越多的由模擬電路實(shí)現(xiàn)的功能轉(zhuǎn)由數(shù)字電路實(shí)現(xiàn)，進(jìn)入了電子系統(tǒng)設(shè)計(jì)的數(shù)字化時(shí)代。
關(guān)鍵詞：Σ-Δ DAC，F(xiàn)PGA，VerilogHDL，可綜合
性
在各類(lèi)電子系統(tǒng)中，數(shù)字電路所占比重越來(lái)越大。這主要是因?yàn)閿?shù)字電路相對(duì)于 電路有一些突出的優(yōu)點(diǎn)，例如：1 數(shù)字電路中的有源器件工作在飽和區(qū) 與截止區(qū)，工作狀態(tài)穩(wěn)定；2 數(shù)字電路處理的是二值信號(hào)，易于存儲(chǔ)和再生；3 數(shù)字電路是由大量相同的基
本單元，如門(mén)、觸發(fā)器等所組成，易于大規(guī)模集成，易于自動(dòng)化設(shè)計(jì)工具的應(yīng)用等。再加上數(shù)字計(jì)算機(jī)和數(shù)字信號(hào)處理技術(shù)的迅速發(fā)展，使得數(shù)字電路從集成規(guī)模、應(yīng)用范圍及設(shè)計(jì)自動(dòng)化程度等方面都大大超過(guò)了模擬電路，越來(lái)越多的由模擬電路實(shí)現(xiàn)的功能轉(zhuǎn)由數(shù)字電路實(shí)現(xiàn)，進(jìn)入了電子系統(tǒng)設(shè)計(jì)的數(shù)字化時(shí)代。
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