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整個設(shè)計采用MAX+?plus II開發(fā)平臺，VHDL編程實現(xiàn)，基于可編程邏輯器件CPLD設(shè)計多波形信號發(fā)生器。用VHDL編程實現(xiàn)，其設(shè)計過程簡單，極易修改，可移植性強。系統(tǒng)以CPLD為核心，采用直接數(shù)字合成技術(shù)，輔以必要的模擬電路，構(gòu)成一個波形穩(wěn)定，精度較高的函數(shù)信號發(fā)生器。
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