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數(shù)據(jù)采集FPGA實(shí)現(xiàn)

2018-02-07 | rar | 未知 | 次下載 | 3積分

資料介紹

  大多數(shù)現(xiàn)實(shí)世界的信號都為模擬信號,模擬數(shù)字轉(zhuǎn)換器AD)將模擬世界與數(shù)字世界聯(lián)系在一起。數(shù)字信號處理技術(shù)已經(jīng)成為了當(dāng)前信號處理領(lǐng)域的主流技術(shù),隨著電子通信、測量技術(shù)的不斷發(fā)展,對模數(shù)轉(zhuǎn)換器提出了更高的要求。AD是通信系統(tǒng)向高頻化、數(shù)字化發(fā)展的重要組成部分,其性能直接影響著系統(tǒng)的特性。由于工藝的限制,單片模數(shù)轉(zhuǎn)換器轉(zhuǎn)換速率幾乎已經(jīng)達(dá)到極限。基于上述原因,利用多片AD組成的時(shí)間交錯(cuò)采樣系統(tǒng),可以很好的解決單片AD最高采樣速率的限制,從而實(shí)現(xiàn)高速采樣。

  首先介紹了交錯(cuò)采集原理,然后利用其原理設(shè)計(jì)了硬件電路,編寫了FPGA軟件程序并對采集數(shù)據(jù)進(jìn)行了分析。設(shè)計(jì)中AD采用AD9220來實(shí)現(xiàn)采樣系統(tǒng),它的最大采樣率為10MHz,量化位數(shù)為12位,通過選用2片AD9220,利用時(shí)間交錯(cuò)技術(shù)實(shí)現(xiàn)了最大采樣速率為20MHz,量化位數(shù)保持在12位的數(shù)據(jù)采集器。FPGA芯片選擇XILINX公司的XC3S500E,它有豐富的邏輯資源、大容量的RAM、4個(gè)時(shí)鐘管理單元(DCM)、具有豐富的全局時(shí)鐘單元、有豐富的端口資源,支持多種電平標(biāo)準(zhǔn)。

數(shù)據(jù)采集FPGA實(shí)現(xiàn)

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