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面向便攜式設備的SoC設計，不僅僅要求性能高、體積小，更要求功耗低。一般而言，SoC的靜態功耗很小，而對負載電容充放電的動態功耗很大。
SoC內部，總線上掛著很多功能設備，導致總線的電容負載很大。如果總線與片外設備聯系，那么，它還要驅動很長的片外連線以及片外設備，負載高達50pF，比SoC內部各個節點的電容負載0.05pF高出三個量級。一般而言，總線的功耗占SoC總功耗的10%80%一個已經對內部電路優化過的SoC，總線功耗約占5 0%。隨著寬度的增加，總線消耗的功率占SoC總功率的比重越來越大，因此，總線的低功耗設計很重要。
很多通過減少總線動態翻轉來降低總線功耗的算法已經被提出來。數據總線的數據隨機性較大，地址總線的地址向量連續性較大。它們傳送的數值各有特點，所以，針對不同類型總線的算法也不一樣。針對數據總線有bus-inve rt算法，針對地址總線有PBE （Page-Ba s ed Encoding）算法、WZE（Working Zone Encoding）算法等。本文利用地址總線零翻轉編碼方法，通過設計編碼器和解碼器的結構，有效地降低SoC地址總線的功耗。
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