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標簽 > PLL電路
PLL 電路的工作原理是將外部信號的相位與壓控晶體振蕩器 （VCXO） 產生的時鐘信號的相位進行比較。然后，電路調整振蕩器時鐘信號的相位以匹配參考信號的相位。因此，原始參考信號和新信號彼此精確地同相。
一個鎖相環PLL電路通常由以下模塊組成：
1）鑒相鑒頻器PFD（Phase Frequency Detector）：對輸入的基準信號（來自頻率穩定的晶振）和反饋回路的信號進行頻率的比較，輸出一個代表兩者相位差異的信號。
2）低通濾波器LPF（Low-Pass Filter）：將PFD中生成的差異信號的高頻成分濾除，保留直流部分。
3）壓控振蕩器VCXO（Voltage Controlled Oscillator）：根據輸入電壓，輸出對應頻率的周期信號。利用變容二極管（偏置電壓的變化會改變耗盡層的厚度，從而影響電容大小）與電感構成的LC諧振電路構成，提高變容二極管的逆向偏壓，二極管內耗盡層變大，電容變小，LC電路的諧振頻率提高，反之，降低逆向偏壓時，二極管內電容變大，頻率降低。
4）反饋回路FL（Feedback Loop）：通常由一個分頻器實現。將VCXO的輸出降低到與基準信號相同級別的頻率才能在PFD中比較
實現高頻輸出的方法前言數據傳輸速度和容量繼續增加，以支持流量的持續增長-主要是由于物聯網等的普及，對高速網絡的需求通信基礎設施正在推動對高頻信號源的強勁...
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鎖相環 （PLL） 是電子系統中最通用、最靈活和最有價值的電路配置之一，因此在許多應用中都有使用。它用于時鐘重定時和恢復，作為頻率合成器和可調諧振蕩器，...
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今天想來聊一聊芯片設計中的一個非常基礎的概念——時鐘。對于外行來說聽到這個詞可能會感覺迷茫，猜一個大概意思吧可能也不太準。
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