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bram技術(shù)

BRAM和URAM重要的片上存儲資源，兩者有顯著的區(qū)別

BRAM和URAM都可級聯(lián)，只是級聯(lián)方式不同。在使用BRAM時，我們只需要設(shè)定寬度和深度，并根據(jù)時鐘頻率合理選擇Latency，也就是選擇是否需要使用B...

2019-03-06 標(biāo)簽：寄存器 BRAM 2.8萬 0

簡單講解AXI Interconnect IP核的使用方法

最近需要用到AXI接口的模塊，xilinx的IP核很多都用到了AXI總線進行數(shù)據(jù)和指令傳輸。如果有多個設(shè)備需要使用AXI協(xié)議對AXI接口的BRAM進行讀...

2023-06-19 標(biāo)簽：控制器 RTL VCS 1.0萬 0

【FPGA ZYNQ Ultrascale+ MPSOC教程】33.BRAM實現(xiàn)PS與PL交互

有時CPU需要與PL進行小批量的數(shù)據(jù)交換，可以通過BRAM模塊，也就是Block RAM實現(xiàn)此要求。本章通過Zynq的GP Master接口讀寫PL端的...

2021-02-22 標(biāo)簽：fpga cpu Zynq 8195 0

Vivado中BRAM IP的配置方式和使用技巧

FPGA開發(fā)中使用頻率非常高的兩個IP就是FIFO和BRAM，上一篇文章中已經(jīng)詳細(xì)介紹了Vivado FIFO IP，今天我們來聊一聊BRAM IP。

2023-08-29 標(biāo)簽：fpga 寄存器 fifo 6060 0

FPGA設(shè)計中BRAM的知識科普

FPGA設(shè)計中，BRAM是一項非常關(guān)鍵的內(nèi)置存儲資源，F(xiàn)PGA開發(fā)需要熟練使用BRAM，今天再復(fù)習(xí)一下BRAM的知識，包括BRAM的定義、組成、應(yīng)用等等。

2023-08-15 標(biāo)簽：fpga DRAM FPGA設(shè)計 5453 0

論SRAM型FPGA軟核Microblaze抗單粒子加固的方法

Microblaze是32位/64位 RISC軟核處理器，可以用作微處理器、實時處理器和應(yīng)用處理器（Linux+MMU）。

2023-08-28 標(biāo)簽：fpga sram 微處理器 3753 0

Xilinx FPGA AXI4總線（二）用實例介紹5個讀寫通道

AXI4協(xié)議是一個點對點的主從接口協(xié)議，數(shù)據(jù)可以同時在主機（Master）和從機（Slave）之間**雙向** **傳輸** ，且數(shù)據(jù)傳輸大小可以不同。

2023-06-21 標(biāo)簽：FPGA設(shè)計 FIFO存儲 BRAM 3480 0

MicroBlaze大內(nèi)部存儲器(AXI BRAM)設(shè)計

MicroBlaze可以使用AXI BRAM存放數(shù)據(jù)和指令。有些客戶軟件很大，需要把AXI BRAM的空間做到最大。AXI BRAM底層是Block R...

2022-08-02 標(biāo)簽：存儲器 MicroBlaze BRAM 3192 0

奇數(shù)分頻如何得到呢？解讀奇數(shù)分頻和邏輯分析儀（ILA）的使用

前言：偶數(shù)分頻容易得到：N倍偶數(shù)分頻，可以通過由待分頻的時鐘觸發(fā)計數(shù)器計數(shù)，當(dāng)計數(shù)器從0計數(shù)到N/2-1時，輸出時鐘進行翻轉(zhuǎn)，并給計數(shù)器一個復(fù)位信號，...

2020-12-28 標(biāo)簽：計數(shù)器邏輯分析儀 BRAM 2947 0

如何復(fù)用原有設(shè)計中Block的位置

保存Block的位置信息。一旦固定了BRAM的位置，即可點擊Vivado菜單欄內(nèi)的保存按鈕，這樣就把BRAM的位置信息保存到了target約束文件中。一...

2019-01-29 標(biāo)簽：Block BRAM 2926 0

FPGA的BRAM資源使用優(yōu)化策略

FPGA的BRAM和LUT等資源都是有限的，在FPGA開發(fā)過程中，可能經(jīng)常遇到BRAM或者LUT資源不夠用的情況。

2023-08-30 標(biāo)簽：fpga 芯片 ROM 2871 0

基于FPGA的圖形生成與視頻處理系統(tǒng)的設(shè)計與實現(xiàn)

本文對基于FPGA的機載視頻圖形顯示系統(tǒng)架構(gòu)進行設(shè)計和優(yōu)化。從實時性、BRAM資源占用和DDR3吞吐量三方面進行分析，改進幀速率提升算法來提高實時性；改...

2017-11-18 標(biāo)簽：fpga ddr3 bram 2442 0

怎樣使用毛刺濾波器來濾除毛刺和反彈？

可編程邏輯系統(tǒng)通常部署在可能存在噪聲的應(yīng)用中。這種噪聲會影響可編程邏輯設(shè)計接收的信號。

2023-08-30 標(biāo)簽：濾波器寄存器狀態(tài)機 2337 0

Xilinx FPGA AXI4總線（一）介紹【AXI4】【AXI4-Lite】【AXI-Stream】

從 FPGA 應(yīng)用角度看看 AMBA 總線中的 AXI4 總線。

2023-06-21 標(biāo)簽：控制器 FPGA設(shè)計 DDR 2279 0

fpga內(nèi)部主要結(jié)構(gòu)及其功能分析（Kintex-7FPGA內(nèi)部結(jié)構(gòu)）

Kintex-7 FPGA的內(nèi)部結(jié)構(gòu)相比傳統(tǒng)FPGA的內(nèi)部結(jié)構(gòu)嵌入了DSP48E1，PCIE，GTX,XADC,高速IO口等單元，大大提升了FPGA的性能。

2023-08-24 標(biāo)簽：dsp fpga Xilinx 2114 0

FIFO IP核報Memory Collision Error on RAMB36E1解決方案

以前很少用到仿真，這次在仿真的過程中，遇到了某個警告，于是轉(zhuǎn)過頭又去研究了FIFO中的Safety Circuit的作用。

2023-06-19 標(biāo)簽：FPGA設(shè)計 RAM FIFO存儲 1732 0

AXI VIP當(dāng)作master時如何使用？

?AXI接口雖然經(jīng)常使用，很多同學(xué)可能并不清楚Vivado里面也集成了AXI的Verification IP，可以當(dāng)做AXI的master、pass t...

2023-07-27 標(biāo)簽：仿真器 VCS AXI總線 1671 0

基于FPGA BRAM的多端口地址查找表與FPGA BRAM的資源分析

在多端口交換機的設(shè)計中，交換機的每個端口都會各自維護一張查找表，數(shù)據(jù)幀進入到交換機后，需要進行查表和轉(zhuǎn)發(fā)。

2024-05-01 標(biāo)簽：FPGA 存儲器交換機 1563 0

關(guān)于EDA工具整合低功耗設(shè)計、驗證和提高生產(chǎn)力的設(shè)計

Cadence Low-Power Solution是用于低功耗芯片的邏輯設(shè)計、驗證和實現(xiàn)的完全集成的、標(biāo)準(zhǔn)化的流程，將領(lǐng)先的設(shè)計、驗證和實現(xiàn)技術(shù)與Si...

2018-11-13 標(biāo)簽：EDA工具數(shù)字信號處理 BRAM 1497 0

Xilinx FPGA異步復(fù)位同步釋放—同步后的復(fù)位該當(dāng)作同步復(fù)位還是異步復(fù)位？

針對異步復(fù)位、同步釋放，一直沒搞明白在使用同步化以后的復(fù)位信號時，到底是使用同步復(fù)位還是異步復(fù)位？

2023-06-21 標(biāo)簽：寄存器觸發(fā)器 FDR 1474 0

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