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標簽 > clk

clk

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clk技術(shù)

任意偶數(shù)的分頻器設(shè)計

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所謂“分頻”,就是把輸入信號的頻率變成成倍數(shù)地低于輸入頻率的輸出信號。

2023-06-05 標簽:驅(qū)動器分頻器計數(shù)器 1445 0

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2023-11-07 標簽:uart同步傳輸時鐘信號 1434 0

JESD204B具體調(diào)試過程

說的是一塊數(shù)字采集板的調(diào)試,主要器件也不多,主要是公司的ADC,ADI的時鐘芯片和Xilinx的FPGA,還有一些DC-DC和LDO。

2022-11-18 標簽:fpgaldoDC-DC 1416 0

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每次作為面試官問一些RTL功耗優(yōu)化的問題時候,都會希望聽到一個答案:優(yōu)化了RTL的clk-gating比例。

2023-12-04 標簽:寄存器RTL觸發(fā)器 1395 0

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編寫一個創(chuàng)建模塊dut實例(具有任何實例名稱)的測試平臺,并創(chuàng)建一個時鐘信號來驅(qū)動模塊的clk輸入。時鐘周期為 10 ps。時鐘應(yīng)初始化為零,其第一個轉(zhuǎn)...

2023-03-13 標簽:VerilogHDL時鐘信號 1383 0

FPGA時序分析-建立時間和保持時間裕量都是inf怎么解決呢?

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今天有個小伙伴遇到一個問題,就是在vivado里面綜合后看到的建立時間和保持時間裕量都是inf,我們來看看怎么解決這個問題。

2023-07-30 標簽:fpgaFPGA設(shè)計寄存器 1362 0

從鎖存器角度看亞穩(wěn)態(tài)發(fā)生的原因及方案簡單分析

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發(fā)生亞穩(wěn)態(tài)的原因是信號在傳輸?shù)倪^程中不能滿足觸發(fā)器的建立時間和保持時間。

2023-06-20 標簽:鎖存器觸發(fā)器FIFO存儲 1361 0

復(fù)位消抖電路具體長什么樣子呢?

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復(fù)位信號在使用前一般需要進行消抖處理,也稱為復(fù)位濾毛刺。復(fù)位的抖動可能會導(dǎo)致芯片產(chǎn)生多次復(fù)位動作,給系統(tǒng)帶來不確定性和誤差。

2023-12-04 標簽:D觸發(fā)器延時器CLK 1339 0

怎么設(shè)計一個32bit浮點的加法器呢?

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設(shè)計一個32bit浮點的加法器,out = A + B,假設(shè)AB均為無符號位,或者換個說法都為正數(shù)。

2023-06-02 標簽:C語言加法器CLK 1334 0

聊聊使用Verdi去分析NBA Delay的問題

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NBA 就是 NonBlocking Assignment,非阻塞賦值 的縮寫。它通常用來描述一個用時鐘沿觸發(fā)的寄存器。

2023-06-09 標簽:寄存器仿真器VCS 1326 0

介紹一下奇數(shù)分頻器的設(shè)計

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入門從簡單開始,先來個三分頻分析一下。三分頻其實就是把輸入時鐘的三個周期當(dāng)作一個周期,具體波形如圖所示。

2023-06-05 標簽:分頻器計數(shù)器觸發(fā)器 1284 0

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OSERDES實現(xiàn)并串轉(zhuǎn)換,只需要管發(fā)送并不需要管接收到的數(shù)據(jù)如何,所以它的操作相對于ISERDES來說簡單;

2023-06-16 標簽:FPGA設(shè)計DDRSDR 1282 0

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請根據(jù)這段代碼寫一個assertion檢查 count 每次加5。

2023-08-12 標簽:VCSSVAFIFO存儲 1211 0

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2023-11-16 標簽:fifoCLKVivado 1196 0

Easier UVM Code Generator Part 4:生成層次化的驗證環(huán)境

本文使用Easier UVM Code Generator生成包含多個agent和interface的uvm驗證環(huán)境。

2023-06-06 標簽:UVM生成器CLK 1180 0

Verilog除法器設(shè)計

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取被除數(shù)的高幾位數(shù)據(jù),位寬和除數(shù)相同(實例中是 3bit 數(shù)據(jù))。

2023-05-30 標簽:寄存器Verilog除法器 1179 0

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組合邏輯的延遲Tc,從FF1/CK到FF1/Q的延遲為Tq,定義Treal = Tq + Tc,從建立時間和保持時間這兩個標準去考察Treal。

2023-12-01 標簽:RTL觸發(fā)器時序分析 1154 0

為什么要用Serdes?

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在芯片內(nèi)部,信號一般都是通過并行傳輸?shù)模驗榇袀鬏攲嵲谑翘恕?/p>

2023-09-01 標簽:CLKI2C協(xié)議ADC采樣 1154 0

所有的單比特信號跨時鐘域都可以用敲兩級DFF的辦法處理嗎?

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用敲兩級DFF的辦法(兩級DFF同步器)可以實現(xiàn)單比特信號跨時鐘域處理。但你或許會有疑問,是所有的單比特信號跨時鐘域都可以這么處理嗎?

2023-06-28 標簽:信號處理器同步器CLK 1132 0

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2023-12-05 標簽:可變電阻狀態(tài)機交流電壓 1076 0

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