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First Input First Output的縮寫，先入先出隊列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進(jìn)入的指令先完成并引退，跟著才執(zhí)行第二條指令。

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賽普拉斯推出72 Mbit先進(jìn)先出(FIFO)存儲器

賽普拉斯半導(dǎo)體公司日前宣布推出一款容量高達(dá) 72 Mbit 的先進(jìn)先出 (FIFO) 存儲器。該款全新的高容量 (HD) FIFO 是視頻及成像應(yīng)用的理...

2011-06-17 標(biāo)簽：賽普拉斯存儲器 FIFO 2692 0

MAX3108帶有FIFO的SPI UART

小尺寸的MAX3108通用異步收發(fā)器與128字的接收和發(fā)送FIFO每個(UART)是控制通過串行I ² C或SPI™控制器接口。

2011-02-22 標(biāo)簽：FIFO SPI UART 1550 0

基于FPGA的并行多通道激勵信號產(chǎn)生模塊

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2011-01-21 標(biāo)簽：fpga fifo 1222 0

基于異步FIFO和鎖相環(huán)(PLL)的雷達(dá)數(shù)據(jù)采集系統(tǒng)

　　1 引言　　隨著雷達(dá)系統(tǒng)中數(shù)字處理技術(shù)的飛速發(fā)展，需要對雷達(dá)回波信號進(jìn)行高速數(shù)據(jù)采集。在嵌入式條件下，要求獲取數(shù)據(jù)的速度越來越快。精度越來越高，以致數(shù)

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FPGA設(shè)計的高速FIFO電路技術(shù)

FPGA設(shè)計的高速FIFO電路技術(shù) 本文主要介紹高速FIFO電路在數(shù)據(jù)采集系統(tǒng)中的應(yīng)用，相關(guān)電路主要有高速A/D轉(zhuǎn)換器、FPGA、SDRAM存儲器等。...

2010-05-27 標(biāo)簽：FPGA FIFO 2691 0

高速異步FIFO的設(shè)計與實現(xiàn)

高速異步FIFO的設(shè)計與實現(xiàn) 　　引言　　現(xiàn)代集成電路芯片中，隨著設(shè)計規(guī)模的不斷擴大．一個系統(tǒng)中往往含有數(shù)個時鐘。多時鐘帶來的一個問題就是，如何設(shè)

2010-04-12 標(biāo)簽：FIFO 3019 0

異步FIFO和PLL在高速雷達(dá)數(shù)據(jù)采集系統(tǒng)中的應(yīng)用

異步FIFO和PLL在高速雷達(dá)數(shù)據(jù)采集系統(tǒng)中的應(yīng)用 1 引言隨著雷達(dá)系統(tǒng)中數(shù)字處理技術(shù)的飛速發(fā)展，需要對雷達(dá)回波...

2009-12-22 標(biāo)簽：FIFO PLL 2326 0

基于FPGA的FIFO設(shè)計和應(yīng)用

基于FPGA的FIFO設(shè)計和應(yīng)用引言　　在利用DSP實現(xiàn)視頻實時跟蹤時，需要進(jìn)行大量高速的圖像采集。而DSP本身自帶的FIFO并不足以支持系...

2009-11-20 標(biāo)簽：FPGA FIFO 2244 0

異步FIFO結(jié)構(gòu)及FPGA設(shè)計

摘要：首先介紹異步FIFO的概念、應(yīng)用及其結(jié)構(gòu)，然后分析實現(xiàn)異步FIFO的難點問題及其解決辦法；在傳統(tǒng)設(shè)計的基礎(chǔ)上提出一種新穎的電路結(jié)構(gòu)并對其進(jìn)行

2009-06-20 標(biāo)簽：FIFO 3922 0

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2006-03-13 標(biāo)簽：fifo dsp芯片 939 0

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