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MPSoC VCU調(diào)試方法和調(diào)試流程
MPSoC VCU在很多產(chǎn)品中得到了應(yīng)用。在不同產(chǎn)品的調(diào)試過程中,有一些共同的辦法。首先看看Video子系統(tǒng)的簡單框圖,其中包含視頻輸入、編解碼、視頻輸...
CSU SWDT、LPD SWDT和FPD SWDT的關(guān)系與使用
在Zynq MPSoC的器件里,PS (Processing System )集成了三個看門狗,分別是CSU SWDT,LPD SWDT和FPD SWD...
挪威科技大學(xué)Revolve團隊基于瑞蘇盈科MPSoC核心板打造電動方程式賽車
由于ZX5 VCU(Vehicle Control Unit,車輛控制單元)項目在2020年的成功,基于核心板打造電機控制器底板就自然而然成為一個很好的...
【FPGA ZYNQ Ultrascale+ MPSOC教程】33.BRAM實現(xiàn)PS與PL交互
有時CPU需要與PL進行小批量的數(shù)據(jù)交換,可以通過BRAM模塊,也就是Block RAM實現(xiàn)此要求。本章通過Zynq的GP Master接口讀寫PL端的...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第三十二章PL讀寫PS端DDR數(shù)據(jù)
PL和PS的高效交互是zynq soc開發(fā)的重中之重,我們常常需要將PL端的大量數(shù)據(jù)實時送到PS端處理,或者將PS端處理結(jié)果實時送到PL端處理,常規(guī)我們...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第三十一章FreeRTOS實驗
如何搭建Free RTOS實時操作系統(tǒng)運行環(huán)境,這里不深入探討Free RTOS的具體使用。本實驗以FreeRTOS Hello World做舉例,并實...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第三十章自定義IP實驗
創(chuàng)建自己的IP核有很多好處,例如系統(tǒng)設(shè)計定制化;設(shè)計復(fù)用,可以在在IP核中加入license, 有償提供給別人使用;簡化系統(tǒng)設(shè)計和縮短設(shè)計時間。用ZYN...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十九章PL端AXI GPIO的使用
使用zynq最大的疑問就是如何把PS和PL結(jié)合起來使用,在其他的SOC芯片中一般都會有GPIO,本實驗使用一個AXI GPIO的IP核,讓PS端通過AX...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十八章PS端EMIO的使用
如果想用PS點亮PL的LED燈,該如何做呢?一是可以通過EMIO控制PL端LED燈,二是通過AXI GPIO的IP實現(xiàn)控制。本章介紹如何使用EMIO控制...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十七章System Monitor
本章介紹system monitors的使用,用于監(jiān)測芯片的電壓、溫度值等,也可以通過PL端的ADC引腳作為外部信號的采集。PL端可以做17路ADC的采...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十六章PS端網(wǎng)絡(luò)遠(yuǎn)程更新QSPI
在實際工作中,會遇到產(chǎn)品升級問題,如果按照程序燒錄的方式,可能需要打開產(chǎn)品的外殼,這無疑。本章介紹一種通過網(wǎng)絡(luò)遠(yuǎn)程更新FLASH程序的方法,包含UDP和...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十五章PS端以太網(wǎng)使用之lwip
開發(fā)板有兩路千兆以太網(wǎng),通過RGMII接口連接,本實驗演示如何使用Vitis自帶的LWIP模板進行PS端千兆以太網(wǎng)TCP通信。 LWIP雖然是輕量級協(xié)...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十四章PS端SD卡讀寫
FatFs是一個通用的文件系統(tǒng)模塊,用于在小型嵌入式系統(tǒng)中實現(xiàn)FAT文件系統(tǒng)。FatFs的編寫遵循 ANSI C,因此不依賴于硬件平臺。它可以嵌入到便宜...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十三章PS端DP的使用
DisplayPort v1.2協(xié)議,支持4個5.4G的lane,但本控制器只支持兩個lane,分辨率最大支持4096*2160@30。
【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十二章PS端I2C的使用
ReadBuffer清0,WriteBuffer賦FF寫16個字節(jié)到EEPROM讀EEPROM的16個字節(jié)到ReadBuffer檢驗是否正確Readbu...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十一章PS端UART讀寫控制
除了打印信息之外,如果我們想用UART進行數(shù)據(jù)傳輸呢?本章便來介紹PS端UART的讀寫控制,實驗中,每隔1S向外發(fā)送一串字符,如果收到數(shù)據(jù),產(chǎn)生中斷,并...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第二十章PS端RTC中斷實驗
實驗中通過簡單的修改Vitis的例程,就完成了RTC,中斷的應(yīng)用,看似簡單的操作,但蘊含了豐富的知識,我們需要非常了解RTC的原理、中斷的原理,這些基本...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第十九章 Hello World(下)
本章從FPGA工程師和軟件工程師兩者角度出發(fā),介紹了ZYNQ開發(fā)的經(jīng)典流程,F(xiàn)PGA工程師的主要工作是搭建好硬件平臺,提供硬件描述文件hdf給軟件工程師...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第十八章 Hello World(上)
我們從原理圖中可以看到ZYNQ芯片分為PL和PS,PS端的IO分配相對是固定的,不能任意分配,而且不需要在Vivado軟件里分配管腳,雖然本實驗僅僅使用...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第十七章Vitis準(zhǔn)備工程及注意事項
所有的工程目錄下都有個bootimage文件夾,存放了對應(yīng)的BOOT.bin文件,可將此文件拷貝到Vitis_image_download文件夾,覆蓋原...
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