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FPGA設計：PLL 配置后的復位設計

先用FPGA的外部輸入時鐘clk將FPGA的輸入復位信號rst_n做異步復位、同步釋放處理，然后這個復位信號輸入PLL，同時將clk也輸入PLL。設計的...

2020-03-29 標簽：fpga dll pll 2819 0

以太網物理層芯片時鐘同步PLL的設計方案

在以太網中，物理層芯片（Physical Layer Interface Devices，PHY）是將各網元連接到物理介質上的關鍵部件。負責完成互連參考...

2019-10-16 標簽：以太網接口 pll 4029 0

函數信號發生器的介紹和任意波形發生器為什么是仿真實驗的最佳儀器

信號發生器一般區分為函數信號發生器及任意波形發生器，而函數波形發生器在設計上又區分出模擬及數字合成式。眾所周知，數字合成式函數信號源無論就頻率、幅度乃至...

2019-10-04 標簽：放大器發生器 PLL 7387 0

Spectrum View 在電源網絡調試及PLL故障診斷場景的應用

作為電子系統的動力源泉，電源網絡質量的優劣將直接影響系統能否正常工作，因此電源測試及調試是保證系統正常工作極其重要的一環。

2019-09-04 標簽：電源 pll spectrum 8296 0

【應用篇】Spectrum View 在電源網絡調試及PLL故障診斷場景的應用

本文將通過常見的電源網絡調試及PLL故障診斷等測試場景進一步描述Spectrum View的應用。

2019-09-03 標簽：示波器泰克 pll 1141 0

SF-EP1C學習板：PLL配置仿真實驗

鎖相環在工作的過程中，當輸出信號的頻率與輸入信號的頻率相等時，輸出電壓與輸入電壓保持固定的相位差值，即輸出電壓與輸入電壓的相位被鎖住，這就是鎖相環名稱的由來。

2019-12-24 標簽：仿真 pll 頻率 2540 0

FPGA之軟件工具篇：矢量波形文件

該篇不僅講解了如何使用Quartus II軟件、ModelSim和SignalTap II軟件，還講解了PLL、ROM、RAM和FIFO IP核的使用。...

2019-12-06 標簽：fpga pll 矢量 2707 0

FPGA視頻教程：SF-EP1C開發板-PLL配置仿真實驗

7、1個串口；1個SD卡接口；1個256色VGA接口；?1個64MBit（4*1M*256Bit）?SDRAM；?8位撥碼開關

2019-12-12 標簽：fpga pll 開發板 2664 0

深入淺出玩轉FPGA視頻：PLL配置仿真實驗

鎖相環PLL，用來統一整合時鐘信號，使高頻器件正常工作，如內存的存取資料等。PLL用于振蕩器中的反饋技術。許多電子設備要正常工作，通常需要外部的輸入信...

2019-12-16 標簽：fpga 仿真 pll 2189 0

深入淺出玩轉FPGA視頻：MAX II內部震動時鐘使用實驗

Altera的MAX? II 系列在所有CPLD系列中，其單位I/O引腳的功耗和成本都是最低的。不但具有傳統CPLD設計的低成本特性，MAX II CP...

2019-12-16 標簽：fpga pll 時鐘 2444 0

正點原子開拓者FPGA視頻：PLL鎖相環實驗

鎖相環路是一種反饋控制電路，簡稱鎖相環（PLL,Phase-Locked Loop）。鎖相環的特點是：利用外部輸入的參考信號控制環路內部振蕩信號的頻率和...

2019-09-20 標簽：fpga 鎖相環 pll 3751 0

FPGA之軟件工具篇：PLL IP核的使用講解

該篇不僅講解了如何使用Quartus II軟件、ModelSim和SignalTap II軟件，還講解了PLL、ROM、RAM和FIFO IP核的使用。...

2019-12-06 標簽：fpga pll ip核 3334 0

鋯石FPGA A4_Nano開發板視頻：PLL IP核的使用講解

PLL用于振蕩器中的反饋技術。許多電子設備要正常工作，通常需要外部的輸入信號與內部的振蕩信號同步。一般的晶振由于工藝與成本原因，做不到很高的頻率，而在...

2019-09-29 標簽：fpga 振蕩器 pll 1881 0

PLL的基本概念及典型應用介紹

第一部分將重點介紹有關PLL的基本概念，同時描述基本PLL架構和工作原理，另外，我們還將舉例說明PLL在通信系統中的用途。最后，我們將展示一種運用ADF...

2019-04-06 標簽：濾波器振蕩器 pll 3.8萬 0

正交DDS信號的上變頻基波輸出挑戰

直接數字合成（DDS）技術正在迅速發展，但直接合成UHF和微波輸出頻率尚不實用或經濟上可行。目前最先進的商用DDS IC（如300 MHz AD9852...

2019-04-04 標簽：pll dds 調制器 5365 0

導致PLL相位噪聲和參考雜散的原因及解決方案

在第二部分中，我們將側重于詳細考察與PLL相關的兩個關鍵技術規格：相位噪聲和參考雜散。導致相位噪聲和參考雜散的原因是什么，如何將其影響降至最低？討論將涉...

2019-04-04 標簽：振蕩器頻率合成器 pll 2.3萬 0

通過信號相位行為提高頻譜和功率效率

鎖相環（PLL）使用相位檢測器將反饋信號與參考信號進行比較，將兩個信號的相位鎖定在一起。雖然此屬性仍有許多應用，但目前PLL最常用于頻率合成，通常用作頻...

2019-04-04 標簽：示波器 pll rf 4477 0

怎樣優化PLL環路來達到理想的相位噪聲和抖動

如果在給定的偏移頻率下有一個相位噪聲規范，那么應該將VCO和參考相位噪聲信息提供給工具，例如ADIsimCLK，并使用它來優化閉環帶寬實現預期目標。該過...

2019-04-10 標簽：pll 抖動相位噪聲 7048 0

AD951x器件的時鐘清除功能的工作原理是怎樣的

PLL環路必須圍繞PLL內核特性和選定的VCO / VCXO進行設計。通常，VCO / VCXO頻率比參考時鐘頻率高一些整數乘數（N）。必須選擇合適的環...

2019-04-10 標簽：pll 器件環路濾波器 3414 0

具有高電壓壓控振蕩器技術的鎖相環電路設計

鎖相環 (PLL) 是現代通信系統的基本組成部分。PLL 通常用于在接收器和發送器中提供本機振蕩器; (LO) 功能；此外，它們還用于時鐘信號分布和降噪...

2019-04-09 標簽：芯片振蕩器 pll 3408 0

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