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用于高頻接收器和發(fā)射器的鎖相環(huán)—第三部分
本系列第一部分 介紹了鎖相環(huán)(PLL),說明了其基本架構(gòu)和工作原理。另外舉例說明了PLL在通信系統(tǒng)中的用途。在 第二部分 中,我們?cè)敿?xì)考察了相位噪聲、參...
2023-06-17 標(biāo)簽:通信系統(tǒng)pllVCO 1457 0
用于高頻接收器和發(fā)射器的鎖相環(huán)—第二部分
在第二部分中,我們將側(cè)重于詳細(xì)考察與PLL相關(guān)的兩個(gè)關(guān) 鍵技術(shù)規(guī)格:相位噪聲和參考雜散。導(dǎo)致相位噪聲和參考雜 散的原因是什么,如何將其影響降至最低?討論...
用于高頻接收器和發(fā)射器的鎖相環(huán)—第一部分
第一部分將重點(diǎn)介紹有關(guān)PLL的基本概念,同時(shí)描述基本PLL 架構(gòu)和工作原理,另外,我們還將舉例說明PLL在通信系統(tǒng) 中的用途。最后,我們將展示一種運(yùn)用A...
提供顯著跳頻(FH)優(yōu)勢的下一代軟件定義無線電(SDR)收發(fā)器
本文深入探討了跳頻(FH)的概念,以及如何通過靈活設(shè)計(jì) ADRV9002?SDR 收發(fā)器的鎖相環(huán)(PLL)架構(gòu)來實(shí)現(xiàn)四大跳頻特性。這些特性可為用戶提供強(qiáng)...
在16通道演示器中驗(yàn)證的經(jīng)驗(yàn)型多通道相位噪聲模型
相位噪聲是衡量所有RF系統(tǒng)設(shè)計(jì)的一個(gè)重要的性能指標(biāo)。在相控陣這類大型多通道RF系統(tǒng)中,通道之間彼此關(guān)聯(lián),其目標(biāo)之一就是利用分布式接收器和發(fā)射器的關(guān)聯(lián)組合...
使用具有射頻鎖相環(huán)相位同步特性的SDR簡化天線校準(zhǔn)
本文著重介紹ADI公司的軟件定義無線電(SDR)中的射頻(RF)鎖相環(huán)(PLL)相位同步特性。這個(gè)功能有助于降低天線校準(zhǔn)的復(fù)雜性,特別是對(duì)于采用大型天線...
XILINX FPGA IP之MMCM PLL DRP時(shí)鐘動(dòng)態(tài)重配詳解
上文XILINX FPGA IP之Clocking Wizard詳解說到時(shí)鐘IP的支持動(dòng)態(tài)重配的,本節(jié)介紹通過DRP進(jìn)行MMCM PLL的重新配置。
FPGA時(shí)序約束之衍生時(shí)鐘約束和時(shí)鐘分組約束
在FPGA設(shè)計(jì)中,時(shí)序約束對(duì)于電路性能和可靠性非常重要。在上一篇的文章中,已經(jīng)詳細(xì)介紹了FPGA時(shí)序約束的主時(shí)鐘約束。
2023-06-12 標(biāo)簽:fpgaFPGA設(shè)計(jì)pll 2783 0
淺談STM32單片機(jī)的時(shí)鐘系統(tǒng)
今天來總結(jié)一下stm32單片機(jī)的時(shí)鐘系統(tǒng),也就是時(shí)鐘樹的相關(guān)知識(shí)點(diǎn)。單片機(jī)正常工作的三要素是電源、時(shí)鐘、復(fù)位電路。由此可以說,時(shí)鐘的正常工作是單片機(jī)...
MAX2395鎖相環(huán)(PLL)在鑒相頻率為80kHz時(shí)的性能
針對(duì)WCDMA/UMTS系統(tǒng),該應(yīng)用筆記介紹了在鑒相頻率為80kHz時(shí),使用MAX2395的一個(gè)優(yōu)化的環(huán)路濾波器設(shè)計(jì)。參考頻率是13MHz或26MHz,...
復(fù)位后,RA6 MCU開始以中速片上振蕩器 (MOCO) 作為主時(shí)鐘源運(yùn)行。復(fù)位時(shí),默認(rèn)情況下主振蕩器和PLL處于關(guān)閉狀態(tài)。HOCO和IWDT可能處于打...
先來聊一聊什么是時(shí)鐘抖動(dòng)。時(shí)鐘抖動(dòng)實(shí)際上是相比于理想時(shí)鐘的時(shí)鐘邊沿位置,實(shí)際時(shí)鐘的時(shí)鐘邊沿的偏差,偏差越大,抖動(dòng)越大。實(shí)際上,時(shí)鐘源例如PLL是無法產(chǎn)生...
2023-06-09 標(biāo)簽:pll信號(hào)時(shí)鐘抖動(dòng) 2221 0
本應(yīng)用筆記介紹了壓控振蕩器(VCO)的槽路設(shè)計(jì)方法,并給出了常用的中頻(IF) 85MHz、190MHz、210MHz壓控振蕩器的設(shè)計(jì)實(shí)例。這些設(shè)計(jì)減少...
以PCIE和SATA為例,時(shí)鐘信息通過8b/10b編碼已經(jīng)集成在數(shù)據(jù)流里面,數(shù)據(jù)本身經(jīng)過加擾,不可能有多于5個(gè)0或者5個(gè)1的長串(利于時(shí)鐘恢復(fù)),也不存...
2023-06-06 標(biāo)簽:數(shù)據(jù)pll編碼 1796 0
鎖相環(huán)(PLL)電路設(shè)計(jì)及仿真分析
本文以SoC中的PLL為例,對(duì)PLL電路進(jìn)行設(shè)計(jì)和仿真。
2023-06-02 標(biāo)簽:鎖相環(huán)電路設(shè)計(jì)soc 8978 0
鎖相環(huán)(PLL)規(guī)格及架構(gòu)研究
鎖相環(huán)(PLL),作為Analog基礎(chǔ)IP、混合信號(hào)IP、數(shù)字系統(tǒng)必備IP,廣泛存在于各類電子產(chǎn)品中。
ADALM2000實(shí)驗(yàn):鎖相環(huán)
本實(shí)驗(yàn)活動(dòng)介紹鎖相環(huán)(PLL)。PLL電路有一些重要的應(yīng)用,例如信號(hào)調(diào)制/解調(diào)(主要是頻率和相位調(diào)制)、同步、時(shí)鐘和數(shù)據(jù)恢復(fù),以及倍頻和頻率合成。在這項(xiàng)...
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