仿真測試1：半加器

做任何模塊前，要確定輸入輸出端口有哪些，有一個整體的概念；方便以后模塊調(diào)用；

2023-10-10 標簽：EDA工具仿真器RTL 1582 0

基于Verilog的經(jīng)典數(shù)字電路設(shè)計—計數(shù)器

在數(shù)字系統(tǒng)中，使用得最多的時序電路差不多就是計數(shù)器了。計數(shù)器不僅能夠用于對時鐘脈沖計數(shù)，還可以用于分頻、定時、產(chǎn)生節(jié)拍脈沖、產(chǎn)生脈沖序列以及進行數(shù)字運算等等。

2023-10-09 標簽：計數(shù)器時序電路RTL 1423 0

JK觸發(fā)器與T觸發(fā)器的Verilog代碼實現(xiàn)和RTL電路實現(xiàn)

JK 觸發(fā)器的 Verilog 代碼實現(xiàn)和 RTL 電路實現(xiàn)

2023-10-09 標簽：RTLJK觸發(fā)器觸發(fā)器 4902 0

基于Verilog的經(jīng)典數(shù)字電路設(shè)計（5）譯碼器

前面講完了編碼器，其實不知不覺地，也順便把譯碼器也講了，畢竟，二者是一個相反操作的過程，類似于加減，前進與后退，調(diào)制與解調(diào)，F(xiàn)FT 和 IFFT 等等。

2023-10-09 標簽：二進制LED驅(qū)動譯碼器 2123 0

基于Verilog的經(jīng)典數(shù)字電路設(shè)計（4）編碼器

在近代戰(zhàn)爭中，軍事信息傳遞，例如通過發(fā)電報的方式，電報信息難免被敵方截獲，而我們又不得不通過發(fā)電報傳輸信息（喲，都近代了，就別飛鴿傳書了），所以發(fā)送方需...

2023-10-09 標簽：編碼器RTLLUT 2520 0

基于Verilog的經(jīng)典數(shù)字電路設(shè)計（3）選擇器

在數(shù)字信號的傳輸過程中，有時需要從一組輸入數(shù)據(jù)中選出某一個來，比如輸入有 “A、B、C、D” 四個數(shù)據(jù)，那么我們想要哪個字母輸出，就可以設(shè)置哪個字母輸出

2023-10-09 標簽：邏輯電路RTL數(shù)據(jù)選擇器 3838 0

基于Verilog的經(jīng)典數(shù)字電路設(shè)計（2）比較器

在數(shù)字系統(tǒng)中，總是需要對一些數(shù)據(jù)進行比較，比較兩個數(shù)值甚至多個數(shù)值的大小，然后進行排序，于是，數(shù)值比較器（Comparator）的邏輯電路便應(yīng)運而生。

2023-10-09 標簽：邏輯電路比較器二進制 3406 0

基于Verilog的經(jīng)典數(shù)字電路設(shè)計（1）加法器

加法器是非常重要的，它不僅是其它復(fù)雜算術(shù)運算的基礎(chǔ)，也是 CPU 中 ALU 的核心部件（全加器）。

2023-10-09 標簽：加法器RTL半加器 2630 0

如何使用Verilog語言進行仿真驗證

仿真驗證主要作用是搭建一個測試平臺，測試和驗證程序設(shè)計的正確性，驗證設(shè)計是否實現(xiàn)了我們所預(yù)期的功能。其結(jié)構(gòu)如下圖所示。

2023-10-02 標簽：仿真驗證HDL語言Verilog設(shè)計 1837 0

IC設(shè)計之Verilog代碼規(guī)范

Verilog規(guī)范對于一個好的IC設(shè)計至關(guān)重要。

2023-08-17 標簽：IC設(shè)計Verilog程序 1528 0