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verilog

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Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語言，用它可以表示邏輯電路圖、邏輯表達式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

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Protues

Protues

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機及外圍器件。
靜電防護

靜電防護

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強，編程門檻降低，即使沒有編程經(jīng)驗的人也可以嘗試給Arduino控制器編寫程序。
AD10

AD10

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識別

識別

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FPGA開發(fā)板

FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時間內(nèi)，裝備消費者所需的新一代汽車。
PCB封裝

PCB封裝

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pcb封裝就是把實際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時進行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計輸入到硬件配置的完整PLD設(shè)計流程。
PCB封裝庫

PCB封裝庫

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語音交互

語音交互

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AD09

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PDN

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QuickPcb

QuickPcb

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Artix-7

Artix-7

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　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
VHDL代碼

VHDL代碼

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Protel 99 se

Protel 99 se

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powerlink

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candence

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面包板

面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實驗設(shè)計制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
特性阻抗

特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時在突發(fā)傳輸中，只需要首地址，同時分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進行時序收斂。AXI是AMBA中一個新的高性能協(xié)議。
驅(qū)動電流

驅(qū)動電流

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時鐘源

時鐘源

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時鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時鐘脈沖信號。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
FPGA教程

FPGA教程

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Kintex-7

Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價格實現(xiàn)與其相當性能，性價比提高了一倍，功耗降低了一半。
AD采樣

AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個最小量時模擬信號的變化量。
Protel DXP

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紅外觸摸屏

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[12.2.1]--第13講卡諾圖化簡_clip001

[12.1.2]--第12講卡諾圖：基本定義_clip002

[12.1.2]--第12講卡諾圖：基本定義_clip001

[12.1.1]--第12講卡諾圖_clip002

[12.1.1]--第12講卡諾圖_clip001

[11.1.1]--第11講與非和或非

[10.1.1]--第10講成本

[9.1.1]--第9講積之和、和之積_clip002

[9.1.1]--第9講積之和、和之積_clip001

[8.1.1]--第8講邏輯綜合_clip002

[8.1.1]--第8講邏輯綜合_clip001

[7.1.1]--第7講布爾代數(shù)_clip002

[7.1.1]--第7講布爾代數(shù)_clip001

[6.1.1]--第6講邏輯網(wǎng)絡(luò)_clip002

[6.1.1]--第6講邏輯網(wǎng)絡(luò)_clip001

[5.1.1]--第5講三種功能描述方法_clip002

[5.1.1]--第5講三種功能描述方法_clip001

[4.1.1]--第4講真值表和邏輯網(wǎng)絡(luò)

[3.1.1]--第3講邏輯函數(shù)和開關(guān)邏輯_clip002

[3.1.1]--第3講邏輯函數(shù)和開關(guān)邏輯_clip001

[2.1.1]--第2講二進制、電子開關(guān)

[1.1.2]--第1講簡介

[1.1.1]--第一講簡介

[5.3.2]--2EDK使用基礎(chǔ)

[5.3.1]--1基于FPGA的嵌入式系統(tǒng)

[5.2.3]--3常見代碼問題及設(shè)計原則

[5.2.2]--2可綜合代碼規(guī)范_clip002

[5.2.2]--2可綜合代碼規(guī)范_clip001

[5.1.1]--設(shè)計方法與可綜合設(shè)計

[4.2.4]--4ChipScope的使用

[4.2.3]--3FPGA的配置

[4.2.2]--2ISE選項配置及后仿真

[4.2.1]--1用戶約束文件

[4.1.2]--2原語的使用

[4.1.1]--1IPcore的使用

[3.2.4]--4Synplify綜合技術(shù)入門

[3.2.3]--3ModelSim仿真技術(shù)入門

[3.2.2]--2ISE工程開發(fā)基礎(chǔ)

[3.2.1]--1FPGA設(shè)計流程

[3.1.2]--2Synplify與ChipScope安裝與配置

[3.1.1]--1ISE與ModelSim安裝與配置

[2.4.2]--2Testbench編寫入門

[2.4.1]--1源代碼設(shè)計與仿真

[2.3.4]--4常見的過程語句2

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[2.1.1]--第2講二進制、電子開關(guān)