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FPGA設計論壇

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FPGA職業生涯的五個層次

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2022年6月18日,2022軟科中國大學專業排名正式發布。此次排名,共有990所高校的30242個....
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FPGA拆解FPGA芯片,帶你深入了解其原理

現場可編程門陣列(FPGA)可以實現任意數字邏輯,從微處理器到視頻生成器或加密礦機,一應俱全。FPG....
的頭像 FPGA設計論壇 發表于 11-10 12:15 ?3091次閱讀

FPGA設計需注意的方方面面

不管你是一名邏輯設計師、硬件工程師或系統工程師,甚或擁有所有這些頭銜,只要你在任何一種高速和多協議的....
的頭像 FPGA設計論壇 發表于 11-10 11:20 ?721次閱讀

如果在FPGA設計中不允許latch中現,又如何避免呢?

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的頭像 FPGA設計論壇 發表于 11-08 15:07 ?1020次閱讀

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的頭像 FPGA設計論壇 發表于 11-04 10:51 ?18414次閱讀

數學運算在FPGA中的實現方式

FPGA以擅長高速并行數據處理而聞名,從有線/無線通信到圖像處理中各種DSP算法,再到現今火爆的AI....
的頭像 FPGA設計論壇 發表于 10-31 14:48 ?3103次閱讀

深入了解FPGA廠商并掌握FPGA編程語言

基于以上測試,我大膽預測是示波器的問題,也不能說是示波器的問題吧,估計是沒有這種的應用場景。然后我有....
的頭像 FPGA設計論壇 發表于 10-20 14:44 ?984次閱讀

在FPGA中利用CORDIC算法IP核實現三角函數關系的轉換

在FPGA硬件實現CORDIC的邏輯其實是很簡單的,就是設置好輸入輸出的位寬,然后建立好對應的精度表....
的頭像 FPGA設計論壇 發表于 10-17 11:58 ?3236次閱讀

FPGA浮點數轉化為定點數方法

FPGA在常規運算時不能進行浮點運算,只能進行定點整型運算,在處理數據的小數乘加運算和除法運算時FP....
的頭像 FPGA設計論壇 發表于 10-13 16:23 ?4816次閱讀

FPGA靜態時序分析詳解

靜態時序分析簡稱STA,它是一種窮盡的分析方法,它按照同步電路設計的要求,根據電路網表的拓撲結構,計....
的頭像 FPGA設計論壇 發表于 09-27 14:45 ?2945次閱讀

VHDL和Verilog中數組定義、初始化、賦值方法

方法:實際應用里,通常需要在上電復位過程中對變量進行初始化,如果數組個數少時,直接賦初始值即可,但是....
的頭像 FPGA設計論壇 發表于 09-23 14:20 ?11350次閱讀

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從圖1 FPGA開發流程中的主干線上分離出第一步設計輸入橫向環節,并做了進一步的細節的處理,如圖2,....
的頭像 FPGA設計論壇 發表于 09-20 10:46 ?1021次閱讀

D觸發器實現的原理

上圖是用與非門實現的D觸發器的邏輯結構圖,CP是時鐘信號輸入端,S和R分別是置位和清零信號,低有效;....
的頭像 FPGA設計論壇 發表于 09-19 15:22 ?5450次閱讀

雙線性插值算法的講解

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的頭像 FPGA設計論壇 發表于 09-19 10:25 ?3270次閱讀

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標準的Verilog對語句有兩種分組方式——使用begin…end或fork…join,begin…....
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移位寄存器的設計與實現

移位寄存器的功能和電路形式較多,按移位方向分有左移、右移、和雙向移位寄存器;按接收數據方式分為串行輸....
的頭像 FPGA設計論壇 發表于 09-06 11:35 ?4672次閱讀

DDS信號發生器的理解與實現

DDS信號發生器采用直接數字頻率合成(Direct Digital Synthesis,簡稱DDS)....
的頭像 FPGA設計論壇 發表于 09-01 15:21 ?2659次閱讀

Verilog中clk為什么要用posedge,而不用negedge

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的頭像 FPGA設計論壇 發表于 08-31 15:51 ?4012次閱讀

關于DDR3地址的容量計算

bank是存儲庫的意思,也就是說,一塊內存內部劃分出了多個存儲庫,訪問的時候指定存儲庫編號,就可以訪....
的頭像 FPGA設計論壇 發表于 08-30 14:40 ?2389次閱讀

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時鐘周期約束:?時鐘周期約束,顧名思義,就是我們對時鐘的周期進行約束,這個約束是我們用的最多的約束了....
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的頭像 FPGA設計論壇 發表于 08-03 14:15 ?5408次閱讀

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